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《合肥工业大学》 2004年
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0.6μm CMOS 622Mb/s高速分接器设计

钱立旺  
【摘要】: 分接器是光纤通信网中的关键器件。它位于光纤接收机的末端,将接收到的一路高速信号重新恢复成多路的低速信号。本文简要介绍了分接器的实现工艺和设计流程,以及复接和分接的原理。 分接器有三种主要结构:串型结构、并型结构和树型结构,本文分析了三种结构的工作原理及其优缺点。根据三种结构的各自特点和设计目标,选用树型结构作为分接器的基本结构。 电路设计是分接器设计的基础。速度、功耗、面积是电路设计要考虑的主要因素,不同的电路形式具有不同的优缺点,如CMOS互补逻辑电路功耗低,面积小,速度相对较慢;SCFL(源极耦合FET逻辑)电路速度高,功耗和面积较大。所以要针对具体设计需要选用适当的电路形式或其组合结构,以满足设计要求。触发器是分接器的基本组成单元,建立时间和保持时间是影响电路速度的关键,所以减小建立时间和保持时间是触发器设计的主要目标,本文着重介绍了SCFL锁存器的设计和优化方法。 本文介绍了分接器的版图设计考虑,并给出了仿真结果和芯片的晶圆级测试结果,并对测试结果进行了分析。 本文设计的1:4分接器采用CSMC-HJ 0.6μm CMOS工艺实现,测试结果表明,芯片成功的实现了SDH STM-4级别1:4分接器的功能,最高分接速率可达622Mb/s。
【学位授予单位】:合肥工业大学
【学位级别】:硕士
【学位授予年份】:2004
【分类号】:TN432

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【引证文献】
中国硕士学位论文全文数据库 前2条
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【参考文献】
中国期刊全文数据库 前3条
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【共引文献】
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【同被引文献】
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中国硕士学位论文全文数据库 前10条
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【二级引证文献】
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【二级参考文献】
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【相似文献】
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