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H.264中CABAC编码器的VLSI结构设计

崔弘飞  
【摘要】:信息技术的迅猛发展,将人类带入了一个崭新的信息化社会。随着视频压缩编码技术的不断发展,特别是H.264标准作为新一代视频编码标准的推出,为视频应用开辟了广阔的空间。与此同时,计算机与集成电路技术的快速发展,使得硬件平台的计算和处理速度不断的提高,为复杂的视频编码算法的实时应用奠定了基础。 熵编码是H.264标准中的关键技术,它包括基于上下文的自适应可变长编码(CAVLC)和基于上下文的自适应二进制算术编码(CABAC)两种熵编码方式。本文主要研究H.264主档次中的CABAC熵编码。由于CABAC每编码一个二进制符号需要进行大量的计算,包括二进制化、概率模型选择、二进制算术编码以及更新和维护一个庞大的概率模型,这使得采用软件实现CABAC算法难以满足高清视频编码的实时性要求。于是CABAC的硬件实现变得非常重要。但是由于CABAC算法的高度串行化以及编码数据之间复杂的相关性,使得在硬件结构中并行处理变得非常困难。为此,本文在对CABAC算法进行细致的研究和分析的基础上,提出了一个高效的CABAC编码器硬件结构。 本文首先简要介绍了H.264视频编解码框架以及关键技术,对H.264中的CABAC算法进行了细致的研究和分析,然后从系统架构的角度提出了一个高效的CABAC编码器硬件结构,接着对CABAC编码器中编码序列控制器模块、宏块上下文管理模块、二进制化与模型选择模块以及二进制算术编码模块这四个最主要的功能模块的硬件结构设计进行了详细的介绍。最后,介绍了CABAC编码器的设计验证方法,并对仿真、综合结果进行了分析,实验结果表明本文提出的CABAC编码器硬件结构可以满足1920×1080@30f高清视频实时编码的需求。


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