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带通Σ-Δ调制器的研究和设计

程剑平  
【摘要】: 微电子领域广泛而深入的研究不断推动射频接收机向单片集成的方向发展。最终的目标是使其成为小尺寸、低成本、低功耗的通信器件,并且具有可测试性和多标准的特点。单片实现的目标导致了零中频结构和其它结构的产生,但是许多问题又限制了它们的应用,从而人们转向了能用较多数字电路实现的数字中频结构。这种结构的关键模块是带通Σ-Δ调制器,本文从Σ-Δ调制器的基本理论出发,系统的研究带通调制器的设计方法(包括结构、谐振器以及电路模块),并且实际设计出一种低电压低功耗一位四阶带通Σ-Δ调制器。 作为带通Σ-Δ调制器的设计基础,详细讨论了Nyquist ADC、过采样ADC和Σ-Δ调制器的量化噪声特性;在讨论低通Σ-Δ调制器的基础上,进一步讨论了带通Σ-Δ调制器;介绍了Σ-Δ调制器评估指标和仿真方法,并给出了宏模型模拟方法。 在带通调制器的结构方面:通过深入地分析六类调制器,研究适合带通调制器的结构类型。在此基础上,对离散时间单环一位带通调制器进行了深入的研究并提出两种改进的结构。 在谐振器方面:对于谐振器的z域模型,在已有模型的基础上,建立了谐振器增益和Q值之间的关系。通过对三种类型的开关电容谐振器的分析表明:双延时结构的潜在性能最好,其中的双采样Salo型谐振器功耗较小。因此,对双采样Salo型谐振器进行了重点分析。针对双采样谐振器的带内镜像分量问题,提出了一种改进结构。同时,给出了谐振器的模拟方法。 接着讨论调制器中主要模块的设计技术,包括开关、运算放大器,比较器和反馈DAC,考虑它们在速度、精度和功耗等方面的折衷。提出了一种自举开关,给出了一种改进的增益提高运放结构,并对比较器进行了详细的分析和优化。 在前面研究的基础上,采用0.35μm CMOS工艺设计了一种低电压低功耗带通Σ-Δ调制器。设计过程如下:首先对调制器的功耗进行分析,用以指导系统设计和电路设计;随后通过理论分析和Matlab行为级模型确定调制器中电路模块的指标;接着,进行电路模块的设计和Hspice模拟;最后进行版图设计和整个系统的模拟验证。对GSM系统最大SNDR约为82dB,DR约为85dB,在2V电压下功耗为13.5mW。与参考文献中的调制器进行比较表明:本文设计的电路具有较好的性能。


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