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Turbo乘积码及其缩短码的FPGA实现技术

吴侃侃  
【摘要】:1994年提出的Turbo乘积码(TPC)因其优异的性能引起了人们的广泛关注。作为一种高效的信道编码技术,TPC在码率、译码性能和硬件复杂度方面拥有很大的灵活性,具有良好的应用前景。本文的工作主要包括以下几个方面。 本文首先研究了TPC的编译码原理,详细阐述了基于Chase算法的迭代译码方法,并介绍了对算法的一些改进。本文还研究了缩短TPC的矩阵结构和译码算法。 通过仿真,分析了影响TPC迭代译码性能的各个因素,并且还比较了一些改进算法的译码性能。 设计并实现了基于FPGA的缩短TPC编译码器。其中,采用Xilinx公司Virtex-4系列的XC4VLX60芯片和VHDL语言实现的译码器仅占用7%的逻辑资源和9%的存储资源,最大工作频率142 MHz,吞吐量达到14.17 Mbit/s。


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