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基于FPGA的直接数字频率合成器设计

陈远辉  
【摘要】: 直接频率合成器(DDS)~([11])是一种用数字取样技术为基础,以相位累加器为主体的频率合成器。DDS具有相位噪声低、频率分辨率高、频率转换时间短、工作频带宽线路简洁一系列独特的优点,在军事通信领域中得到广泛的应用。是目前战术通信的主要技术基础之一。 本课题来源于跳频通信频率信号源的研制。本文的任务是用FPGA设计一个直接频率合成器,实现频率变化、相位变化、幅度变化,解决DDS中的时延问题。 本文首先对DDS的原理进行了详细讨论,然后结合现场可编程门阵列器件(FPGA)~([1]),设计实现了基于FPGA为平台的DDS。本设计采用了用VHDL[3]语言和ISE的顶层原理图等多种方式来实现,简化了设计,并经实践证明是可行的。


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